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產(chǎn)品型號(hào)
100G UDP/IP產(chǎn)地
上海
NVMe SPCIe FPGA IP Core SSD M.2 AMD PCI Express 軟 IP 核 AXI4 存儲(chǔ)加速
NVMe AXI Stream/Master FULL FPGA IP Core SSD M.2 PCIe1.4 AXI4 存儲(chǔ)加速
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ISP FPGA 圖像信號(hào)處理 IP Core
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10G TCP/IP 協(xié)議棧 FPGA IP Core 核 萬(wàn)兆以太網(wǎng)絡(luò)加速 AXI4-Stream MAC+PCS/PMA
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100G UDP/IP 協(xié)議棧 FPGA IP Core 核 萬(wàn)兆以太網(wǎng)絡(luò)加速 AXI4-Stream MAC+PCS/PMA
基于 AMD/Xilinx 100G 以太網(wǎng) MAC IP 開發(fā)，MTU 支持高達(dá) 9000Bytes 數(shù)據(jù)傳輸，標(biāo)準(zhǔn)的 AXI4-Stream 接口，支持 AMD/Xilinx Zynq UltraScale+ RFSoC, Zynq UltraScale+ MPSoC, Virtex UltraScale+, Kintex UltraScale+, Artix UltraScale+ 系列 FPGA 器件。100G 萬(wàn)兆以太網(wǎng)以其高帶寬和低延遲的特點(diǎn)，能夠確保數(shù)據(jù)的快速傳輸和實(shí)時(shí)處理，而 TUDP 協(xié)議棧更是提高了數(shù)據(jù)傳輸?shù)男屎蜏?zhǔn)確性。
為您提供了快速可靠、更低成本和更高性能的解決方案，顯著縮短上市時(shí)間，適用于高帶寬、低延遲和高速數(shù)據(jù)傳輸?shù)膱?chǎng)景，如數(shù)據(jù)中心、科研實(shí)驗(yàn)、工業(yè)自動(dòng)化、醫(yī)療、測(cè)試與測(cè)量、4K/8K 高清視頻傳輸、電信、金融交易等領(lǐng)域。
符合 IEEE802.3 標(biāo)準(zhǔn)的 ARP、IPV4、ICMP、UDP 協(xié)議棧
快速傳輸，實(shí)時(shí)處理，支持 UDP/IP 校驗(yàn)和處理
用戶接口和 Ethernet MAC+PCS/PMA IP 接口為標(biāo)準(zhǔn) AXI4-Stream 接口
ARP 報(bào)文應(yīng)答支持所有查詢應(yīng)答，可緩存 10 ARP 表
MTU 支持 9000Bytes ~ 64Bytes 數(shù)據(jù)傳輸
數(shù)據(jù)總線寬度 512bit，322.266MHz 時(shí)鐘
Verilog 代碼解決方案
開發(fā)工具
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UDP/IP 協(xié)議棧 IP Core 與用戶接口、Ethernet MAC+PCS/PMA IP 接口均為標(biāo)準(zhǔn)的 AXI4-Stream 接口，其中 Ethernet MAC+PCS/PMA 可以是任何第三方 IP，在提供的設(shè)計(jì)實(shí)例中，使用的是 AMD/Xilinx 100G Ethernet Subsystem IP。
--AXI萬(wàn)兆以太網(wǎng)MAC-網(wǎng)絡(luò)加速.jpg "100G-UDP-FPGA-IP-Core-核-庫(kù)--AXI萬(wàn)兆以太網(wǎng)MAC-網(wǎng)絡(luò)加速.jpg")
UDP/IP 協(xié)議棧 IP Core 集成在系統(tǒng)設(shè)計(jì)中的位置
設(shè)計(jì)語(yǔ)言
Verilog
開發(fā)工具
Vivado 2020.1
支持器件
AMD Virtex Ultrascale+/Kintex UltraScale+/Artix UltraScale+ 系列
AMD Zynq UltraScale+ MPSoC/Zynq UltraScale+ RFSoC 系列
IP 資源消耗評(píng)估采用 AMD Kintex UltraScale+ 系列 FPGA 開發(fā)板，提供了一個(gè)功能齊全的設(shè)計(jì)平臺(tái)，用于構(gòu)建以通信為中心的以太網(wǎng)應(yīng)用。Kintex UltraScale+ XCKU15P 開發(fā)板提供了一個(gè)帶有參考設(shè)計(jì)的開箱即用型硬件平臺(tái)，可縮短開發(fā)時(shí)間，讓您專注于目標(biāo)應(yīng)用。
器件系列
Kintex UltraScale+
芯片型號(hào)
XCKU15P-FFVE1517
頻率 (MHz)
322.266
CLB Regs
27711
CLB LUTs
17586
CLB
3687
BRAM Tile
26
URAM
0
Design Tools
Vivado 2020.1
注：IP 實(shí)際邏輯資源消耗受實(shí)例化中其他邏輯資源消耗影響
100G UDP/IP 協(xié)議棧網(wǎng)絡(luò)加速 FPGA IP Core 主要適用于需要高帶寬、低延遲和高速數(shù)據(jù)傳輸?shù)膱?chǎng)景，如數(shù)據(jù)中心、科研實(shí)驗(yàn)、工業(yè)自動(dòng)化、醫(yī)療、測(cè)試與測(cè)量、4K/8K 高清視頻傳輸、電信、金融交易等領(lǐng)域。
據(jù)中心網(wǎng)絡(luò)加速以太網(wǎng)MAC-UDP_TCP_IP協(xié)議棧FPGA-IP-Core-核-庫(kù)-AXI.jpg "數(shù)據(jù)中心網(wǎng)絡(luò)加速以太網(wǎng)MAC-UDP_TCP_IP協(xié)議棧FPGA-IP-Core-核-庫(kù)-AXI.jpg")
數(shù)據(jù)中心網(wǎng)絡(luò)加速及云計(jì)算存儲(chǔ)
器學(xué)習(xí).jpg "AI-人工智能-機(jī)器學(xué)習(xí).jpg")
大規(guī)模 AI 與機(jī)器學(xué)習(xí)集群
自動(dòng)化-FPGA-IP-Core-核-庫(kù)-AXI.jpg "工業(yè)自動(dòng)化-FPGA-IP-Core-核-庫(kù)-AXI.jpg")
工業(yè)自動(dòng)化及物聯(lián)網(wǎng)
程醫(yī)療診斷-FPGA-IP-Core-核-庫(kù)-AXI.jpg "遠(yuǎn)程醫(yī)療診斷-FPGA-IP-Core-核-庫(kù)-AXI.jpg")
科研、醫(yī)療成像、基因測(cè)序
媒體娛樂(lè) 4K/8K 高清視頻傳輸
絡(luò)通信以太網(wǎng)MAC-UDP_TCP_IP協(xié)議棧FPGA-IP-Core-核-庫(kù)-AXI.jpg "網(wǎng)絡(luò)通信以太網(wǎng)MAC-UDP_TCP_IP協(xié)議棧FPGA-IP-Core-核-庫(kù)-AXI.jpg")
網(wǎng)絡(luò)通信及金融電信
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